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El nombre de la entidad debe coincidir con el nombre del archivo VHD y con el nombre del proyecto. Entradas de datos: a, b, c, d Entradas de selección: s1, s0 Salida: f La señal selector se comporta
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Guía Básica para Describir y Simular Circuitos Lógicos con el lenguaje VHDL y el programa MAX+plus II
El nombre de la entidad debe coincidir con el nombre del archivo VHD y con el nombre del proyecto. Entradas de datos: a, b, c, d Entradas de selección: s1, s0 Salida: f La señal selector se comporta como un alias para la combinación s1s0. La señal f copia el valor de una entrada de datos (a, b, c, d) según la combinación de los selectores s1 y s0.
muy bueno ahora que estoy capacitandome en la electronica y me parecio un buen complemento ojala todos le pusieran el empeño necesario porque de esa manera se daran cuenta lo que pueden aprender
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julio andres
diciembre, 2008
muy bueno
El curso es muy bueno, bien redactado y facil de entender,se nota inmediatamente que el sr es un experto bien calificado, me encantó
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luis javier
noviembre, 2007
muy, muy bueno
Me parece que es un exelente curso, quedo a espera de una actualizacion que complemente la formacion en cuanto a este tipo de lenguaje.
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NICOLAS
septiembre, 2007
BASICO
ES BASTANTE BASICO Y ESTA ORIENTADO A ALTERA PLUS, Y ME PARECIO DEMASIADO CORTO, PERO PUEDE SERVIR PARA DARCE UNA IDEA BASICA DE ESTE LENGUAJE
